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起止时间:2016-08-16到2016-11-25
更新状态:已完结
第五章 存储层次结构 第五章单元测验
1、 主存按字节编址,地址从3000H到AFFFH。若用存储容量为1K x 4位的存储芯片构成该主存,至少需要()片 。
A:16
B:32
C:64
D:128
答案: 64
2、 假定用若干个1K x 4位的芯片组成一个8K x 8位的存储器,则地址 14FFH 所在芯片的最小地址是()
A:0400H
B:0800H
C:1000H
D:1400H
答案: 1400H
3、 某计算机主存容量为128KB,其中ROM区为16KB,其余为RAM区,按字节编址。现要用2K x 4位的ROM芯片和4K x 8位的RAM芯片来设计该存储器,则需要上述规格的ROM芯片数和RAM芯片数分别是()
A:
8, 14
B:16,14
C:8,28
D:16,28
答案: 16,28
4、 某程序执行过程中访存1050次,其中访问Cache缺失50次,则Cache的命中率是()
A:
4.8%
B:5.0%
C:
95.0%
D:95.2%
答案: 95.2%
5、 假设某计算机按字编址,Cache有4个行,Cache和主存之间交换的块大小为1个字。若Cache的内容初始为空,采用基本二路组相联映射方式(即主存的第0块和第2块属于第0组)和LRU替换算法,当访问的主存地址依次是0,4,8,2,0,6,8,6,4,8时,命中Cache的次数是()。若采用另一种改进的二路组相联映射方式(即主存的第0块和第1块属于第0组),则命中Cache的次数可达到()
A:1, 3
B:2, 3
C:1, 4
D:2, 4
答案: 1, 3
6、 某计算机的Cache共有32块,采用8路组相联映射方式。每个主存块大小为16字节,按字节编址。主存133号单元所在主存块应装入到的Cache组号是 ()
A:0
B:1
C:2
D:3
答案: 0
7、 假定一台计算机的显示存储器用DRAM芯片实现,若要求显示分辨率为800×600,颜色深度为16位,帧频为60Hz,显存总带宽的50%用来刷新屏幕,则需要的显存总带宽至少约为()
A:245Mbps
B:461Mbps
C:922Mbps
D:1843Mbps
答案: 922Mbps
8、 下列关于闪存(Flash Memory)的叙述中,错误的是
A:信息可读可写,并且读、写速度一样快
B:存储元是一种半导体存储器,擦写次数有限
C:掉电后信息不丢失,是一种非易失性存储器
D:采用随机访问方式,可替代计算机外部存储器
答案: 信息可读可写,并且读、写速度一样快
9、 下列因素中,与Cache的命中率无关的是()
A:主存的存取时间
B:块的大小
C:Cache的组织方式
D: Cache的容量
答案: 主存的存取时间
10、 在主存和Cache构成的两极存储体系中,Cache的存取时间是100ns,主存的存取时间是2us,Cache访问失败后CPU才开始访存。如果希望有效(平均)存取时间不超过Cache存取时间的140%,则Cache的命中率至少应为( )
A:96%
B:97%
C:98%
D:99%
答案: 98%
实验七 存储器容量扩展 存储扩展测验
1、 现有32k4位的芯片,欲构成一个64k32位的存储器,需要多少这样的芯片?
A:8
B:16
C:32
D:不需要
答案: 16
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