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起止时间:2020-03-02到2020-07-10
更新状态:已完结
1认识可编程逻辑器件 第1周作业
1、 在SPLD的结构图中，在阵列横线和竖线的交叉点上画“X”，表示横线与竖线是（）。
A:未连接
B:可编程连通
C:固定连接
D:悬空
答案: 可编程连通
2、 FPGA是指（ ）。
A:可编程逻辑阵列
B:复杂可编程逻辑器件
C:只读存储器
D:现场可编程门阵列
答案: 现场可编程门阵列
3、 主流FPGA都采用了基于（ ）工艺的（ ）结构。
A:SRAM，查找表
B:熔丝，与或阵列
C:flash，查找表
D:反熔丝，与或阵列
答案: SRAM，查找表
4、 EDA的中文含义是（ ）。
A:计算机辅助计算
B:计算机辅助制造
C:计算机辅助教学
D:电子设计自动化
答案: 电子设计自动化
5、 下列那个流程是基于EDA软件的FPGA / CPLD一般设计流程（ ）。
A:设计输入->逻辑设计->逻辑综合->功能仿真->布局布线->时序仿真->编程下载
B:逻辑设计->设计输入->逻辑综合->功能仿真->布局布线->时序仿真->编程下载
C:逻辑设计->设计输入->逻辑综合->时序仿真->布局布线->功能仿真->编程下载
D:逻辑设计->设计输入->逻辑综合->布局布线->功能仿真->时序仿真->编程下载
答案: 逻辑设计->设计输入->逻辑综合->功能仿真->布局布线->时序仿真->编程下载
6、 下列关于查找表LUT的说法正确的是（ ）。
A:LUT本质就是一个RAM，保存了逻辑电路的所有可能结果。
B:一个4输入的查找表包含8个存储单元。
C:查找表是FPGA实现逻辑函数的基本逻辑单元，由若干个存储单元和数据选择器构成。
D:FPGA的基本逻辑块内包含LUT、数据选择器和触发器，只能实现组合逻辑功能。
答案: LUT本质就是一个RAM，保存了逻辑电路的所有可能结果。;
查找表是FPGA实现逻辑函数的基本逻辑单元，由若干个存储单元和数据选择器构成。
7、 下列哪些器件属于非易失性器件（ ）。
A:FPGA
B:PROM
C:CPLD
D:flash
答案: PROM;
CPLD;
flash
8、 CPLD和FPGA实现逻辑函数的原理是相同的。
A:正确
B:错误
答案: 错误
分析：CPLD基于与或阵列 FPGA基于查找表 或者 门阵列
9、 FPGA的基本组成包括可配置的逻辑块、可编程的I/O块、可编程布线资源等。
A:正确
B:错误
答案: 正确
10、 由于包含上千个可编程逻辑资源，一片可编程逻辑器件可以实现多片通用型逻辑器件才能实现的功能，改变了传统数字系统的设计方法。
A:正确
B:错误
答案: 正确
11、 可编程逻辑器件从集成密度上可分为 和 。
答案: 低密度 高密度
12、 电路设计人员与EDA工具之间的语言称为 。
答案: (以下答案任选其一都对)HDL;
硬件描述语言
13、 包含延时信息的仿真称为 仿真。
答案: 时序
14、 现场可编程逻辑阵列FPGA技术由 公司首创。
答案: (以下答案任选其一都对)Xilinx;
赛灵思;
xilinx
2 FPGA开发平台的使用 第2周作业
1、 Quartus II是（ ）公司的用于开发可编程逻辑器件的软件。
A:XILINX
B:Altera
C:LATTICE
D:ATMEL
答案: Altera
2、 在Quartus II软件中，下面命名的工程名字哪个是不合法的（ ）。
A:12_test
B:test_12
C:test
D:test12
答案: 12_test
3、 在Quartus II集成环境下为图形文件产生一个元件符号的主要作用是（ ）。
A:综合
B:编译
C:仿真
D:被高层次电路设计调用
答案: 被高层次电路设计调用
4、 Quartus II软件把逻辑综合、布局布线等软件集成在一起，称为（ ）工具。
A:编辑
B:综合
C:编程
D:编译
答案: 编译
5、 在线调试状态下，选择将配置数据装入FPGA中的下载方式应为（ ）。
A:AS
B:PS
C:JTAG
D:AS 或 JTAG
答案: JTAG
6、 当程序调试完成后，应选择（ ）下载方式将程序配置到FPGA芯片中。
A:AS
B:PS
C:JTAG
D:AS 或 JTAG
答案: AS 或 JTAG
7、 应用Quartus II自带仿真工具进行仿真，需要创建（ ）文件，用于编写测试激励信号。
A:Block diagram / Schematic File
B:University Program VWF
C:Verilog HDL File
D:VHDL File
答案: University Program VWF
8、 应用Quartus II 软件开发FPGA器件，生成的编程文件包括下列哪些文件（ ）。
A:.sof
B:.qpf
C:.bdf
D:.pof
答案: .sof;
.pof
9、 Analysis & Synthesis 主要完成以下哪些任务（ ）。
A:进行布局布线
B:对设计文件进行语法检查、设计规则检查
C:把原理图或HDL代码翻译成逻辑表达式
D:用目标芯片中的逻辑元件来实现逻辑表达式
答案: 对设计文件进行语法检查、设计规则检查;
把原理图或HDL代码翻译成逻辑表达式;
用目标芯片中的逻辑元件来实现逻辑表达式
3 Verilog HDL语言基础 第3周作业
1、 根据下图所示的4位并行移位寄存器的IO引脚，关于该模块的定义代码（ ）是正确的。
A:module shifit_reg4;input reg_in,clock;output reg_out;… …endmodule
B:module shifit_reg4;input [3:0] reg_in,clock;output[3:0] reg_out;… …endmodule
C:module shifit_reg4(reg_in,clock,reg_out)input [3:0] reg_in;input clock;output[3:0] reg_out;… …endmodule
D:module shifit_reg4(reg_in,clock,reg_out);input [3:0] reg_in;input clock;output[3:0] reg_out;… …endmodule
答案: module shifit_reg4(reg_in,clock,reg_out);input [3:0] reg_in;input clock;output[3:0] reg_out;… …endmodule
2、 接上题，编写对这个4位并行移位寄存器的仿真激励模块，那么对这个设计模块进行实例引用，实例名为sr1，按位置关联正确的是（ ）。module stimulus;reg [3:] REG_IN;reg CLK;wire REG_OUT;……
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