数字集成电路设计(无锡科技职业学院)1461871444 中国大学MOOC答案2024完整版WYC

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起止时间:2020-09-28到2020-12-31
更新状态:已完结

第1章 VLSI设计概述 单元测验

1、 N型半导体是掺入 价元素构成,多数载流子是 ;P型半导体是掺入 价元素构成,多数载流子是 。

A:三,空穴,五,电子
B:三,电子,五,空穴
C:五,空穴,三,电子
D:五,电子,三,空穴
答案: 五,电子,三,空穴

2、 由底向上设计是一种逐级分解、变换,将系统要求转变为电路和版图的过程。

A:正确
B:错误
答案: 错误

3、 CMOS技术以其速度高和驱动能力大,高频低噪声等优点,成为当今VLSI制造的主流技术。

A:正确
B:错误
答案: 正确

4、 英文缩写MOSFET的中文含义是 。
答案: 金属-氧化物-半导体场效应晶体管

第2章 MOS器件与工艺基础 单元测验

1、 下面哪个是非饱和区的条件?

A:数字集成电路设计(无锡科技职业学院)1461871444 中国大学MOOC答案2024完整版WYC第1张
B:数字集成电路设计(无锡科技职业学院)1461871444 中国大学MOOC答案2024完整版WYC第2张
C:数字集成电路设计(无锡科技职业学院)1461871444 中国大学MOOC答案2024完整版WYC第3张
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答案: 数字集成电路设计(无锡科技职业学院)1461871444 中国大学MOOC答案2024完整版WYC第4张

2、 下面两张图分别描述的是 管和 管的转移特性。数字集成电路设计(无锡科技职业学院)1461871444 中国大学MOOC答案2024完整版WYC第6张数字集成电路设计(无锡科技职业学院)1461871444 中国大学MOOC答案2024完整版WYC第7张

A:增强型NMOS,增强型PMOS
B:增强型NMOS,耗尽型PMOS
C:增强型PMOS,耗尽型NMOS
D:耗尽型PMOS,耗尽型NMOS
答案: 增强型NMOS,耗尽型PMOS

3、 假设等效反相器中NMOS宽长比为2,PMOS宽长比为3,求下图ABC三个NMOS和PMOS管的宽长比。 数字集成电路设计(无锡科技职业学院)1461871444 中国大学MOOC答案2024完整版WYC第8张

A:2,2,2,3,3,3
B:4,4,4,6,6,6
C:4,4,4,3,6,6
D:2,2,2,6,6,6
答案: 4,4,4,3,6,6

4、 下面这个版图实现的功能是什么?数字集成电路设计(无锡科技职业学院)1461871444 中国大学MOOC答案2024完整版WYC第9张

A:数字集成电路设计(无锡科技职业学院)1461871444 中国大学MOOC答案2024完整版WYC第10张
B:数字集成电路设计(无锡科技职业学院)1461871444 中国大学MOOC答案2024完整版WYC第11张
C:数字集成电路设计(无锡科技职业学院)1461871444 中国大学MOOC答案2024完整版WYC第12张
D:数字集成电路设计(无锡科技职业学院)1461871444 中国大学MOOC答案2024完整版WYC第13张
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5、 衬底掺杂浓度越低,多数载流子的浓度也越低,使衬底表面耗尽和反型所需的电压VGS越小,即MOS管的阈值电压值越小。

A:正确
B:错误
答案: 正确

6、 沟道长度调制效应,使有效沟道长度Leff随VDS电压的增加而减小,从而造成饱和区电流随VDS的增加而减小。

A:正确
B:错误
答案: 错误

7、 在NMOS传输门中,管子的栅极接一个控制信号VC,管子的源极作为输入,漏极作为输出。

A:正确
B:错误
答案: 错误

8、 下降时间定义为输出电平从高电平的100%下降到高电平的0%所需要的时间。

A:正确
B:错误
答案: 错误

9、 在CMOS反相器中,为了保证输出达到合格的逻辑电平,必须使输入脉冲信号的脉宽大于反相器的上升时间和下降时间中较小的一个。

A:正确
B:错误




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